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そこそこのFPGAのプロジェクトになるとsynth/implの時間長すぎて暇

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百谷涼花@pepepper_cpp

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implは性質的に数で殴ってもあんま変わんなさそうだし(変わるなら研究室のPC全部クラスタにして計算させる)

百谷涼花@pepepper_cpp

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